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blob: d01e6221a641089eb9539f954735070ae462b14b [file] [log] [blame]
Michał Żygowski72f06ca2020-04-13 21:42:24 +0200[diff] [blame]1/* SPDX-License-Identifier: GPL-2.0-only */
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3#include <southbridge/intel/common/gpio.h>
4
5static const struct pch_gpio_set1 pch_gpio_set1_mode = {
6 .gpio0 = GPIO_MODE_NATIVE,
7 .gpio1 = GPIO_MODE_GPIO, /* CHASSIS_ID0 */
8 .gpio2 = GPIO_MODE_GPIO,
9 .gpio3 = GPIO_MODE_GPIO,
10 .gpio4 = GPIO_MODE_GPIO, /* VGA_CBL_DET# */
11 .gpio5 = GPIO_MODE_GPIO,
12 .gpio6 = GPIO_MODE_GPIO, /* PCH_HS_DET# (unused?) */
13 .gpio7 = GPIO_MODE_GPIO, /* SKU2 */
14 .gpio8 = GPIO_MODE_GPIO,
15 .gpio9 = GPIO_MODE_NATIVE,
16 .gpio10 = GPIO_MODE_NATIVE,
17 .gpio11 = GPIO_MODE_GPIO, /* PCIE_X4_WAKE*/
18 .gpio12 = GPIO_MODE_NATIVE,
19 .gpio13 = GPIO_MODE_GPIO, /* PCIE_X1_WAKE (MT/DT only)*/
20 .gpio14 = GPIO_MODE_GPIO,
21 .gpio15 = GPIO_MODE_GPIO,
22 .gpio16 = GPIO_MODE_GPIO,
23 .gpio17 = GPIO_MODE_GPIO, /* CHASSIS_ID1 */
24 .gpio18 = GPIO_MODE_NATIVE,
25 .gpio19 = GPIO_MODE_NATIVE,
26 .gpio20 = GPIO_MODE_GPIO, /* FLEXBAY_HDR_CBL_DET# */
27 .gpio21 = GPIO_MODE_GPIO, /* BOARD_REV0 */
28 .gpio22 = GPIO_MODE_GPIO,
29 .gpio23 = GPIO_MODE_GPIO,
30 .gpio24 = GPIO_MODE_GPIO,
31 .gpio25 = GPIO_MODE_NATIVE,
32 .gpio26 = GPIO_MODE_NATIVE,
33 .gpio27 = GPIO_MODE_GPIO,
34 .gpio28 = GPIO_MODE_GPIO,
35 .gpio29 = GPIO_MODE_GPIO,
36 .gpio30 = GPIO_MODE_NATIVE,
37 .gpio31 = GPIO_MODE_GPIO, /* Password Clear Jumper */
38};
39
40static const struct pch_gpio_set1 pch_gpio_set1_direction = {
41 .gpio1 = GPIO_DIR_INPUT,
42 .gpio2 = GPIO_DIR_INPUT,
43 .gpio3 = GPIO_DIR_INPUT,
44 .gpio4 = GPIO_DIR_INPUT,
45 .gpio5 = GPIO_DIR_INPUT,
46 .gpio6 = GPIO_DIR_INPUT,
47 .gpio7 = GPIO_DIR_INPUT,
48 .gpio8 = GPIO_DIR_OUTPUT,
49 .gpio11 = GPIO_DIR_INPUT,
50 .gpio13 = GPIO_DIR_INPUT,
51 .gpio14 = GPIO_DIR_OUTPUT,
52 .gpio15 = GPIO_DIR_OUTPUT,
53 .gpio16 = GPIO_DIR_INPUT,
54 .gpio17 = GPIO_DIR_INPUT,
55 .gpio20 = GPIO_DIR_INPUT,
56 .gpio21 = GPIO_DIR_INPUT,
57 .gpio22 = GPIO_DIR_INPUT,
58 .gpio23 = GPIO_DIR_INPUT,
59 .gpio24 = GPIO_DIR_INPUT,
60 .gpio27 = GPIO_DIR_OUTPUT,
61 .gpio28 = GPIO_DIR_OUTPUT,
62 .gpio29 = GPIO_DIR_OUTPUT,
63 .gpio31 = GPIO_DIR_INPUT,
64};
65
66static const struct pch_gpio_set1 pch_gpio_set1_level = {
67 .gpio8 = GPIO_LEVEL_HIGH,
68 .gpio14 = GPIO_LEVEL_HIGH,
69 .gpio15 = GPIO_LEVEL_LOW,
70 .gpio27 = GPIO_LEVEL_LOW,
71 .gpio28 = GPIO_LEVEL_LOW,
72 .gpio29 = GPIO_LEVEL_HIGH,
73};
74
75static const struct pch_gpio_set1 pch_gpio_set1_reset = {
76};
77
78static const struct pch_gpio_set1 pch_gpio_set1_invert = {
79 .gpio2 = GPIO_INVERT,
80 .gpio5 = GPIO_INVERT,
81 .gpio6 = GPIO_INVERT,
82 .gpio11 = GPIO_INVERT,
83 .gpio13 = GPIO_INVERT,
84};
85
86static const struct pch_gpio_set1 pch_gpio_set1_blink = {
87};
88
89static const struct pch_gpio_set2 pch_gpio_set2_mode = {
90 .gpio32 = GPIO_MODE_GPIO, /* SKU0 */
91 .gpio33 = GPIO_MODE_GPIO,
92 .gpio34 = GPIO_MODE_GPIO,
93 .gpio35 = GPIO_MODE_GPIO, /* SKU1 */
94 .gpio36 = GPIO_MODE_NATIVE,
95 .gpio37 = GPIO_MODE_NATIVE,
96 .gpio38 = GPIO_MODE_GPIO, /* CHASSIS_ID2 */
97 .gpio39 = GPIO_MODE_GPIO, /* FP_PRESENCE# */
98 .gpio40 = GPIO_MODE_NATIVE,
99 .gpio41 = GPIO_MODE_NATIVE,
100 .gpio42 = GPIO_MODE_NATIVE,
101 .gpio43 = GPIO_MODE_NATIVE,
102 .gpio44 = GPIO_MODE_GPIO, /* INTRUD_CBL_DET# */
103 .gpio45 = GPIO_MODE_GPIO, /* COM_SER2_DET# (unused?) */
104 .gpio46 = GPIO_MODE_GPIO, /* BOARD_REV1 */
105 .gpio47 = GPIO_MODE_NATIVE,
106 .gpio48 = GPIO_MODE_GPIO,
107 .gpio49 = GPIO_MODE_GPIO,
108 .gpio50 = GPIO_MODE_NATIVE,
109 .gpio51 = GPIO_MODE_NATIVE,
110 .gpio52 = GPIO_MODE_NATIVE,
111 .gpio53 = GPIO_MODE_NATIVE,
112 .gpio54 = GPIO_MODE_NATIVE,
113 .gpio55 = GPIO_MODE_NATIVE,
114 .gpio56 = GPIO_MODE_NATIVE,
115 .gpio57 = GPIO_MODE_GPIO,
116 .gpio58 = GPIO_MODE_NATIVE,
117 .gpio59 = GPIO_MODE_NATIVE,
118 .gpio60 = GPIO_MODE_GPIO,
119 .gpio61 = GPIO_MODE_NATIVE,
120 .gpio62 = GPIO_MODE_NATIVE,
121 .gpio63 = GPIO_MODE_NATIVE,
122};
123
124static const struct pch_gpio_set2 pch_gpio_set2_direction = {
125 .gpio32 = GPIO_DIR_INPUT,
126 .gpio33 = GPIO_DIR_OUTPUT,
127 .gpio34 = GPIO_DIR_OUTPUT,
128 .gpio35 = GPIO_DIR_INPUT,
129 .gpio38 = GPIO_DIR_INPUT,
130 .gpio39 = GPIO_DIR_INPUT,
131 .gpio44 = GPIO_DIR_INPUT,
132 .gpio45 = GPIO_DIR_INPUT,
133 .gpio46 = GPIO_DIR_INPUT,
134 .gpio48 = GPIO_DIR_INPUT,
135 .gpio49 = GPIO_DIR_OUTPUT,
136 .gpio57 = GPIO_DIR_OUTPUT,
137 .gpio60 = GPIO_DIR_OUTPUT,
138 .gpio63 = GPIO_DIR_OUTPUT,
139};
140
141static const struct pch_gpio_set2 pch_gpio_set2_level = {
142 .gpio33 = GPIO_LEVEL_HIGH,
143 .gpio34 = GPIO_LEVEL_HIGH,
144 .gpio49 = GPIO_LEVEL_HIGH,
145 .gpio57 = GPIO_LEVEL_LOW,
146 .gpio60 = GPIO_LEVEL_HIGH,
147};
148
149static const struct pch_gpio_set2 pch_gpio_set2_reset = {
150};
151
152static const struct pch_gpio_set3 pch_gpio_set3_mode = {
153 .gpio64 = GPIO_MODE_NATIVE,
154 .gpio65 = GPIO_MODE_NATIVE,
155 .gpio66 = GPIO_MODE_NATIVE,
156 .gpio67 = GPIO_MODE_NATIVE,
157 .gpio68 = GPIO_MODE_GPIO, /* BOARD_REV2 */
158 .gpio69 = GPIO_MODE_GPIO, /* USB_HDR_DET# */
159 .gpio70 = GPIO_MODE_GPIO, /* FP_CHAS_DET# */
160 .gpio71 = GPIO_MODE_GPIO,
161 .gpio72 = GPIO_MODE_GPIO,
162 .gpio73 = GPIO_MODE_GPIO,
163 .gpio74 = GPIO_MODE_GPIO, /* ME_MFG_MODE */
164 .gpio75 = GPIO_MODE_NATIVE,
165};
166
167static const struct pch_gpio_set3 pch_gpio_set3_direction = {
168 .gpio68 = GPIO_DIR_INPUT,
169 .gpio69 = GPIO_DIR_INPUT,
170 .gpio70 = GPIO_DIR_INPUT,
171 .gpio71 = GPIO_DIR_OUTPUT,
172 .gpio72 = GPIO_DIR_OUTPUT,
173 .gpio73 = GPIO_DIR_INPUT,
174 .gpio74 = GPIO_DIR_OUTPUT,
175};
176
177static const struct pch_gpio_set3 pch_gpio_set3_level = {
178 .gpio71 = GPIO_LEVEL_HIGH,
179 .gpio72 = GPIO_LEVEL_HIGH,
180 .gpio74 = GPIO_LEVEL_HIGH,
181};
182
183static const struct pch_gpio_set3 pch_gpio_set3_reset = {
184 .gpio74 = GPIO_RESET_RSMRST,
185};
186
187const struct pch_gpio_map mainboard_gpio_map = {
188 .set1 = {
189 .mode = &pch_gpio_set1_mode,
190 .direction = &pch_gpio_set1_direction,
191 .level = &pch_gpio_set1_level,
192 .blink = &pch_gpio_set1_blink,
193 .invert = &pch_gpio_set1_invert,
194 .reset = &pch_gpio_set1_reset,
195 },
196 .set2 = {
197 .mode = &pch_gpio_set2_mode,
198 .direction = &pch_gpio_set2_direction,
199 .level = &pch_gpio_set2_level,
200 .reset = &pch_gpio_set2_reset,
201 },
202 .set3 = {
203 .mode = &pch_gpio_set3_mode,
204 .direction = &pch_gpio_set3_direction,
205 .level = &pch_gpio_set3_level,
206 .reset = &pch_gpio_set3_reset,
207 },
208};