/*
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 */

#include <soc/sdram.h>

struct rk3399_sdram_params params = {
	{
		{
			.rank = 0x2,
			.col = 0xA,
			.bk = 0x3,
			.bw = 0x2,
			.dbw = 0x2,
			.row_3_4 = 0x0,
			.cs0_row = 0xF,
			.cs1_row = 0xF,
			.ddrconfig = 1,
			{
				{0x801d181e},
				{0x17050a08},
				{0x00000002},
				{0x00006426},
				{0x0000004c},
				0x00000000
			}
		},
		{
			.rank = 0x2,
			.col = 0xA,
			.bk = 0x3,
			.bw = 0x2,
			.dbw = 0x2,
			.row_3_4 = 0x0,
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				{0x801d181e},
				{0x17050a08},
				{0x00000002},
				{0x00006426},
				{0x0000004c},
				0x00000000
			}
		}
	},
	.ddr_freq = 933*MHz,
	.dramtype = LPDDR3,
	.num_channels = 2,
	.stride = 13,
	.odt = 1,
	{
		{
			0x00000700,	/* DENALI_CTL_00_DATA */
			0x00000000,	/* DENALI_CTL_01_DATA */
			0x00000000,	/* DENALI_CTL_02_DATA */
			0x00000000,	/* DENALI_CTL_03_DATA */
			0x00000000,	/* DENALI_CTL_04_DATA */
			0x0000005e,	/* DENALI_CTL_05_DATA */
			0x0002d976,	/* DENALI_CTL_06_DATA */
			0x000003a6,	/* DENALI_CTL_07_DATA */
			0x0000247a,	/* DENALI_CTL_08_DATA */
			0x0000005e,	/* DENALI_CTL_09_DATA */
			0x0002d976,	/* DENALI_CTL_10_DATA */
			0x000003a6,	/* DENALI_CTL_11_DATA */
			0x0000247a,	/* DENALI_CTL_12_DATA */
			0x0000005e,	/* DENALI_CTL_13_DATA */
			0x0002d976,	/* DENALI_CTL_14_DATA */
			0x000003a6,	/* DENALI_CTL_15_DATA */
			0x0100247a,	/* DENALI_CTL_16_DATA */
			0x00000000,	/* DENALI_CTL_17_DATA */
			0x00000101,	/* DENALI_CTL_18_DATA */
			0x00020100,	/* DENALI_CTL_19_DATA */
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			0x000001d3,	/* DENALI_CTL_21_DATA */
			0x00000000,	/* DENALI_CTL_22_DATA */
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			0x00081c00,	/* DENALI_CTL_24_DATA */
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			0x2f110828,	/* DENALI_CTL_27_DATA */
			0x283b0a00,	/* DENALI_CTL_28_DATA */
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			0x0800ff4f,	/* DENALI_CTL_33_DATA */
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			0x0800ff4f,	/* DENALI_CTL_37_DATA */
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